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칩이 점점 작아지면서 무어의 법칙에 따라 속도를 유지하는 것이 과거보다 오늘날 어려울 것이라고 William Holt는 말했습니다. 제프리 글로벌 테크놀로지, 미디어 및 텔레콤 컨퍼런스 연설에서 인텔 기술 제조 그룹의 수석 부사장 겸 총책임자를 선임했다.
"우리는 5 년 전보다 끝이 가까웠습니까? 홀트는 "우리는 현실적으로 우리가 끝까지 예측할 수있는 시점에 있다고 생각하지 않는다"며 "우리는 전자 장치의 개선을 가능하게하는 기본 요소를 지속적으로 제공 할 것이라고 확신한다"고 말했다. 홀트 대변인은 옵서버와 업계 임원들에 의해 무어의 법칙이 죽었다는 주장을 일축하면서 "칩을 규모를 줄이기위한 업계의 능력 말살은 수십 년 동안 모든 사람들의 마음에 주제였다. 홀트 대변인은 인텔의 법안에 대한 일부 예측은 근시안적이었으며, 인텔이 칩 크기를 축소함에 따라 패러다임이 계속 적용될 것이라고 덧붙였다. 인텔은인텔이 어떤 일이 일어날지를 알기 위해 여기에 온 것은 아니지만 앞으로 10 년이 지나면 이것은 너무 복잡한 공간입니다 적어도 몇 세대 동안 우리는 끝이 보이지 않을 것이라고 확신합니다 "라고 홀트는 세대 간의 제조 과정에 대해 이야기합니다.
무어의 법칙이 처음이었습니다 1965 년 고르도 무어 (Gordon Moore)에 의해 설립되었으며, 1968 년 Intel을 공동 설립하고 1975 년 CEO가되었다. 1965 년 Electronic magazine에 실린이 법에 대한 최초의 논문은 비용 당 트랜지스터와 관련된 경제에 초점을 맞추 었으며
"미래를 볼 때 무어의 법칙에 대한 경제가 상당한 스트레스를 받고 있다는 사실은 이것이 근본적으로 당신이 제공하는 것이기 때문에 아마도 적절할 것입니다. 당신은 각 세대의 비용 편익을 전달하고 있으며, "홀트는 말했다.
스케일링의 어려움을 보완하기 위해 인텔은 새로운 도구와 혁신에 의존했습니다.
처음 20 년 정도의 단순한 스케일링뿐만 아니라 새로운 세대를 겪을 때마다 스케일링이나 개선이 계속 될 수 있도록 무언가를하거나 무언가를 추가해야합니다 "라고 Holt는 말했습니다
인텔
인텔은 오늘날 업계에서 가장 앞선 제조 기술을 보유하고 있으며 많은 새로운 공장을 최초로 구현했습니다. 인텔은 트랜지스터 성능을 향상시킨 90 나노 미터 및 65 나노 미터 공정에 스트레인 드 실리콘을 추가 한 다음 45 나노 및 32 나노 공정에서 하이 -k 메탈 게이트라고도하는 게이트 산화물 재료를 추가했습니다.
인텔은 트랜지스터 구조를 22 나노 공정에서 3D 형태로 변경하여 칩 축소를 계속했다. 최신 22 나노 칩은 트랜지스터를 서로 겹치게 배치하여 이전 제조 기술의 경우와 같이 서로가 아닌 3D 디자인을 제공합니다.
인텔은 과거에 칩을 만들었지 만, 지난 2 년 동안 Altera, Achronix, Tabula 및 Netronome과 같은 회사의 칩을 제조하기위한 제조 시설을 개방했습니다. 지난주 인텔은 전 제조 책임자 인 브라이언 크 르자 니치 (Brian Krzanich)를 CEO로 임명하여 대형 칩 제조 계약을 맺음으로써 공장에서 수익을 창출하려고 시도 할 것이라는 신호를 보냈다. 애플의 이름은 인텔의 잠재 고객 중 하나로 떠오르고있다.
인텔의 경우 제조의 발전은 회사의 시장 요구와도 관련이있다. PC 시장이 약화됨에 따라 인텔은 최신 제조 기술을 기반으로하는 태블릿과 스마트 폰 용 전력 효율적인 Atom 칩을 우선적으로 출시했습니다. 인텔은 내년에 22nm 공정을 사용하여 만든 Atom 칩을 내년에 출하 할 것으로 예상되며, 내년에는 14nm 공정을 사용하여 제작 된 칩이 뒤 따른다. 인텔은 이번 주에 22 나노 미터의 새로운 Atom 칩을 발표했다. 실버 몬트 (Silvermont)라는 아키텍처는 이전의 32 나노 미터 공정을 사용하여 만든 전선보다 최대 3 배 빠르고 전력 효율이 5 배나 높다. Atom 칩은 Bay Trail을 포함하는데, 올해 말에 태블릿에 사용될 예정이다. 서버용 Avoton; 메리 필드 (Merrifield)는 내년에 스마트 폰을 구입할 예정이다. 인텔은 오늘날 대부분의 스마트 폰과 태블릿에서 사용되는 프로세서를 따라 잡기 위해 노력하고있다.
IBM과 같은 회사에서 연구가 진행되고 있습니다. 미국 정부의 국립 과학 재단 (National Science Foundation)은 "무어의 법칙 뒤에있는 과학 및 공학"이라는 노력을 주도하고 있으며, 제조, 나노 기술, 멀티 코어 칩 및 양자와 같은 신흥 기술에 대한 연구에 자금을 지원하고있다. 홀트는 인텔이 1 년에 180 나노 공정에서 구리 인터커넥트로 전환 한 것을 지적하면서, 즉각적인 변화를하지 않는 것이 좋다고 말했다. 인텔은 구리에 대한 늦은 발동기였다. 당시 홀트는 옳은 결정이라고 말했다. "그 장비 세트는 그 시점에서 충분히 성숙하지 못했다. 초기에 움직 인 사람들은 힘들게 고전했다"고 홀트는 말했다. 인텔이 액침 리소그래피로 늦게 전환하여 수백만 달러를 절약 할 수 있었다고 덧붙였다.
인텔이 이머전 리소그래피로 옮겨 갈 무렵에는 얼리 어답터가 어려움을 겪었지만 원활하게 전환했다.
다음 큰 움직임 칩 제조업체는 450mm 웨이퍼를 사용하기 때문에 적은 비용으로 더 많은 칩을 공장에서 만들 수 있습니다. 작년 7 월 인텔은 공구 제조업체 인 ASML에 21 억 달러를 투자하여 소형 칩 회로 및 대형 웨이퍼를 구현했습니다. TSMC (Taiwan Semiconductor Manufacturing Co.)와 삼성 역시 Intel의 주도하에 ASML에 투자했다. TSMC의 고객 중 일부는 ARM 프로세서 기반의 칩을 설계하는 Qualcomm 및 Nvidia를 포함합니다. ASML에 대한 Intel의 투자는 극한의 자외선 (Ultraviolet Ultraviolet: 극 자외선) 기술을 구현하기위한 도구의 개발과 관련이 있었기 때문에 더 많은 트랜지스터를 규소. EUV는 마스크를 사용하여 실리콘상의 회로 패턴을 전사하는데 필요한 파장 범위를 단축시킨다. 따라서 웨이퍼에서 더 미세한 이미지를 만들 수 있고 칩은 더 많은 트랜지스터를 휴대 할 수 있습니다. 이 기술은 무어의 법칙이 지속되는 데 결정적인 역할을합니다. <959> 홀트는 인텔이 450 밀리미터 웨이퍼로 전환 할시기를 예측할 수 없었으며, 10 년이 끝날 때까지 올 것이라고 기대했습니다. EUV는 도전적으로 판명 났으며, 구현되기 전에 해결해야 할 공학적 문제가 있다고 덧붙였다.
그럼에도 불구하고 Holt는 인텔의 TSMC 및 GlobalFoundries와 같은 경쟁 업체보다 규모를 축소하고 남을 수있는 능력에 확신을 가졌습니다. TSMC 및 GlobalFoundries는 16nm 및 14nm 프로세스에서 3D 트랜지스터 구현을 따라 제조를 따라 잡으려고합니다. 년. 그러나 인텔은 2 세대 3D 트랜지스터로 나아가고 경쟁사와 달리 트랜지스터를 축소함으로써 제조 우위를 확보하게되었다.
인텔의 경쟁사에 대해 말하면서, 홀트는 "그들은 상당히 정직하고 개방적이기 때문에 면적 축소를 중단 할 것이기 때문에 비용 절감 효과를 기대할 수 없을 것입니다. 우리는 계속해서 트랜지스터 성능면에서 상당한 우위를 점할 것입니다. "
스웨덴 법원은 목요일에 에릭슨 전 임원 3 명을 해임했다. 스웨덴 법원은 19 일 에세이 통제 철회 혐의로 기소 된 과거와 현재 2 명의 에릭슨 중역 3 명을 석방했다. 유죄 판결을 받으면 경영진은 감옥에 갇힐 수있다. 에릭슨 (Ericsson)의 기업 통신 담당 수석 부사장 인 헨리 스테 슨 (Henry Sténson)에 따르면, 평결은 고소 된 공직자들에게 엄청난 구제 수단으로 제공된다. 스톡홀름 지방 법원이 2006 년 12 월에 무죄 판결했을 때 1 라운드. Sténson에 따르면 당시 검찰은 Stronson에 따르면 그만 두었다가 세금 감면 혜택을 많이 받았다.
사건은 회계 관련 부정 행위와 관련이있다. 1998 년과 1 년에 에릭슨이 소위 상업 대리점에 지불 한 수십억 스웨덴 크로노 (수억 달러)로 이루어진 지불에 이르기까지. 1998 년 중반에 에릭슨은 상업적 대리인 지불 시스템 수정을 시작했습니다. 에릭슨은 여러 나라에서 현지 규칙, 관습, 문화 및 언어에 익숙한 현지 대표를 사용하는 것이 중요하다고 말했습니다. Ericsson은 에이전트의 익명 성을 보호하기 위해 지불 시스템을 수정했습니다. 이 수정으로 인해 Ericsson에 따르면 서비스 회사라고하는 현재 지불 중개인을 통해 대행사에 대한 대금 지급이 이루어졌다.
IBM은 현실과 공상 과학의 경계를 모호하게하고 있습니다. DNA의 골격에 자체 조립 칩을 만들어 현재의 제조 방법을 초월하려고 시도했다. 무어의 법칙은 더 작은 칩을 제조 할 수있는 기술을 능가하고 있으며 더 이상 처리 능력을 확장 할 수없는 이론적 최대치에 빠르게 접근하고있다. 기하 급수적으로 ... 적어도 전통적인 칩 제조 기술을 사용하지는 않습니다. IBM은 현실과 공상 과학의 경계를 모호하게 만들고 DNA의 골격에 자체 조립 칩을 만들어 현재의 제조 방법을 초월하려고 시도하고 있습니다. 무어의 법칙에 따르면 대략 단일 칩에 짜 넣은 트랜지스터의 수는 , 또는 CPU의 전체 처리 능력은 2 년마다 효과적으로 2 배로 증가하도록 기하 급수적으로 증가합니다. 이는 1958 년에 최초의 집적 회로가 개발 된 이래로 50 년 이상 동안 사실이었습니다. 무어의 법칙과 전자 장치를 더 작게 만드는 욕구의 결합은 칩 제조업체가 만들 수있는 한계를 뛰어 넘습니다. 현재, 22 나노 미터 기
IBM의 엔지니어들은 더 작은 전통적 제조 기술을 구축하고 22 나노 미터 한계를 넘어서기보다는 캘리포니아 공과 대학교 (California Institute of Technology) 과학자의 트릭을 빌려 DNA 자기 조립 구조를 만드는 데 사용할 수 있습니다. DNA 용액을 회로 템플릿에 적용한 다음 수백만 개의 나노 튜브 또는 나노 입자를 적용합니다. 다량의 정보를 통합하고 복잡한 구조를 형성하는 DNA의 고유 한 능력은 DNA와 통합 된 나노 기술을 집적 회로로 만듭니다.
인텔은 금요일 Larrabee 그래픽 프로세서의 상용 출시를 지연 시켰습니다. Intel은 자사의 Larrabee 그래픽 프로세서의 상용 출시를 지연시키고 있습니다. 2010 년에 언젠가는 많은 코어 칩을 판매 할 계획 이었으나, 라라 비 (Larrabee)의 개발을 기대했던 곳으로 떨어졌고, 인텔 대변인은 금요일에 말했다. 인텔은 그래픽 칩 공급에 전념하고 있으며 내년에 추가 계획에 대해 논의 할 것이라고 대변인은 말했다. 그는 9 월에 샌프란시스코의 인텔 개발자 포럼 (Intel Developer Forum)에서 라라 비 (Larrabee)를 기반으로 한 시스템을 시연했다. 그는 9 월에 라라 비 (Larrabee)를 기반으로 한 시스템을 시연했다. 그것은 그 칩이 내년에 출하 될 것이지만, 구체적인 날짜는 밝히지 않았다. 인텔은 칩 코어에 대해 몇 가지 기본적인 코어 정보를 보유하고 있으며, 보유 할 프로세서 코어 수를 포함한다.
라라 비는 인텔 최초의 개별 그래픽 프로세서이다. 이 기술은 멀티 코어 CPU와 동일한 유형의 작업을 수행 할 수있는 많은 코어 프로세서이지만 데이터 처리를 위해 더 많은 파이프 라인을 제공함으로써 더 많은 병렬 처리를 제공 할 수 있습니다.